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基于 FPGA的多串口通信设计与实现

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摘要摘要：由于 FPGA 属于并行逻辑电路结构，各个串口模块可同时进行数据收发而不会相互影响，利用 FPGA 支持的调用 IP核设计方式，在每个串口模块的前端，为发送和接收端分别配置一个 FIFO 模块，用于对通信数据进行缓存。通过对 FIFO 的 IP 核进行简单设置，为每一个串口模块设计出 FIFO缓冲单元，提高了各路串口的传输效率，从而简单有效的完成各路串口的数据缓冲功能设计。

DOI 7dmekm3r4n/4804930

作者李潇彦

机构地区黑龙江省宥安工程管理有限公司黑龙江省哈尔滨市 150010

出处《科学与技术》 2020年9期

关键词 FPGA 串口通信设计

分类 [建筑科学][建筑技术科学]

出版日期 2020年09月14日（中国期刊网平台首次上网日期，不代表论文的发表时间）