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  • 简介:摘 要:本文采用可编逻辑设计来完成时统终端的设计,从工程实践角度介绍了针对现场实际信号质量的优化容错设计方案。在硬件上提供了一种基于FPGA/CPLD等可编逻辑器件,可以稳定、可靠解析IRIG-B信号的方法。

  • 标签: IRIG-B 可编程逻辑器件 容错设计